上海 [2009-10-19]
Cadence模型化的Litho Physical和Litho Electrical Analyzer解決方案提供了快速、精確矽認證的全晶片電氣DFM 驗證流程
【加州聖荷塞，2009年10月19日】全球電子設計創新領先企業Cadence設計系統公司（NASDAQ: CDNS）今天宣佈，中芯國際積體電路製造有限公司（中芯國際”,紐約證交所股份代號：SMI；香港聯合交易所股票代碼: 0981.HK）採用了Cadence? Litho Physical Analyzer與Cadence Litho Electrical Analyzer，從而能夠更準確地預測壓力和光刻差異對65和45納米半導體設計性能的影響。 Cadence Litho Electrical Analyzer—半導體行業第一個用於各大領先半導體公司從90到40納米生產中的DFM電氣解決方案—與Cadence Litho Physical Analyzer結合，形成了一個能精確預測最終矽片結果的流程。
此前單個單元和庫的電氣行為可在一個單獨的環境中進行預先標示，該單獨環境在給定的、基於目標制程技術的設計中使用時可保持一致性。在65及更小納米，單元的每次放置都產生了自己的一套物理和電氣差異，這些差異與鄰近的單元或環境有關。 這種“與環境有關的差異”已成為關鍵的問題，可導致晶片設計失敗。 Cadence Encounter? Digital Implementation System (EDI)無縫地整合了Litho Physical Analyzer與Litho Electrical Analyzer，可在全晶片實現之前進行嚴苛的、與環境有關的單元物理與電氣簽收。 該流程利用了模型化的物理與電氣可製造性（DFM）技術，可提高標準單元庫、知識產權（IP）核、及全晶片的品質和可靠性，從而提高完整晶片的製造成品率。
“在65和45納米上必須解決物理和電氣差異，這需要一種整體性的方法，它要始於單元級別，並考慮到設計的整個環境，” 中芯國際設計服務中心副總裁劉明剛表示，“通過Cadence的DFM流程，我們能夠分析單元和IP差異，並能對它們在真實矽片中的性能進行精確建模。 通過標示和減少差異，我們的客戶將能減少防護帶並制出更高品質的矽片。 該解決方案還能實現近線性可擴展性，而這對於全晶片電氣DFM驗證流程來說是必需的。
Cadence已開發出業界最完整的設計側DFM預防、分析和簽收方法學之一，並包括Encounter Digital Implementation System設計側優化。它也被用於32和28納米庫的差異建模。“快速、精確、與環境有關的單元光刻與壓力效應差異建模，對實現65納米及以下節點實現有價值生產設計非常關鍵，”Cadence實現集團研發副總裁徐季平表示。“眾多一次矽片成功已證明了高容量半導體設計DFM分析工具的價值。”
關於Cadence
Cadence公司成就全球電子設計技術創新，並在創建當今積體電路和電子產品中發揮核心作用。我們的客戶採用Cadence的軟體、硬體、設計方法和服務，來設計和驗證用於消費電子產品、網路和通訊設備以及電腦系統中的尖端半導體器件、印刷電路板和電子系統。公司總部位於美國加州聖荷塞市，在世界各地均設有銷售辦事處、設計中心和研究設施，以服務於全球電子產業。關於公司、產品及服務的更多資訊，敬請流覽公司網站 www.cadence.com
關於中芯國際
中芯國際積體電路製造有限公司（“中芯國際”，紐約證交所股票代碼：SMI，香港聯合交易所股票代碼：981），是世界領先的積體電路晶片代工企業之一， 也是中國內地規模最大、技術最先進的積體電路晶片代工企業。中芯國際向全球客戶提供0.35微米到45納米晶片代工與技術服務。中芯國際總部位於上海，在 上海建有一座300mm晶片廠和三座200mm晶片廠。在北京建有兩座300mm晶片廠,在天津建有一座200mm晶片廠，在深圳有一座200mm晶片廠 在興建中，在成都擁有一座封裝測試廠。中芯國際還在美國、歐洲、日本提供客戶服務和設立行銷辦事處，同時在香港設立了代表處。此外，中芯代成都成芯半導體 製造有限公司經營管理一座200mm晶片廠，也代武漢新芯積體電路製造有限公司經營管理一座300mm晶片廠。詳細資訊請參考中芯國際網站 http://www.smics.com
媒體聯絡請洽：
楊麗莉
Cadence設計系統公司
電話：021 -61222358
Email：lilyyang@cadence.com
徐晶晶
科聞一百公共關係
電話：021-64263989-216
Email：kitty.xu@text100.com.cn
繆為夷
中芯國際公關處
電話：+8621 3861 0000
郵件：Angela_Miao@smics.com
劉慕華
中芯國際投資人關係處
電話：+86 21 3861 0000
郵件：Beverly_Liu@smics.com
Cadence模型化的Litho Physical和Litho Electrical Analyzer解決方案提供了快速、精確矽認證的全晶片電氣DFM 驗證流程
【加州聖荷塞，2009年10月19日】全球電子設計創新領先企業Cadence設計系統公司（NASDAQ: CDNS）今天宣佈，中芯國際積體電路製造有限公司（中芯國際”,紐約證交所股份代號：SMI；香港聯合交易所股票代碼: 0981.HK）採用了Cadence? Litho Physical Analyzer與Cadence Litho Electrical Analyzer，從而能夠更準確地預測壓力和光刻差異對65和45納米半導體設計性能的影響。 Cadence Litho Electrical Analyzer—半導體行業第一個用於各大領先半導體公司從90到40納米生產中的DFM電氣解決方案—與Cadence Litho Physical Analyzer結合，形成了一個能精確預測最終矽片結果的流程。
此前單個單元和庫的電氣行為可在一個單獨的環境中進行預先標示，該單獨環境在給定的、基於目標制程技術的設計中使用時可保持一致性。在65及更小納米，單元的每次放置都產生了自己的一套物理和電氣差異，這些差異與鄰近的單元或環境有關。 這種“與環境有關的差異”已成為關鍵的問題，可導致晶片設計失敗。 Cadence Encounter? Digital Implementation System (EDI)無縫地整合了Litho Physical Analyzer與Litho Electrical Analyzer，可在全晶片實現之前進行嚴苛的、與環境有關的單元物理與電氣簽收。 該流程利用了模型化的物理與電氣可製造性（DFM）技術，可提高標準單元庫、知識產權（IP）核、及全晶片的品質和可靠性，從而提高完整晶片的製造成品率。
“在65和45納米上必須解決物理和電氣差異，這需要一種整體性的方法，它要始於單元級別，並考慮到設計的整個環境，” 中芯國際設計服務中心副總裁劉明剛表示，“通過Cadence的DFM流程，我們能夠分析單元和IP差異，並能對它們在真實矽片中的性能進行精確建模。 通過標示和減少差異，我們的客戶將能減少防護帶並制出更高品質的矽片。 該解決方案還能實現近線性可擴展性，而這對於全晶片電氣DFM驗證流程來說是必需的。
Cadence已開發出業界最完整的設計側DFM預防、分析和簽收方法學之一，並包括Encounter Digital Implementation System設計側優化。它也被用於32和28納米庫的差異建模。“快速、精確、與環境有關的單元光刻與壓力效應差異建模，對實現65納米及以下節點實現有價值生產設計非常關鍵，”Cadence實現集團研發副總裁徐季平表示。“眾多一次矽片成功已證明了高容量半導體設計DFM分析工具的價值。”
關於Cadence
Cadence公司成就全球電子設計技術創新，並在創建當今積體電路和電子產品中發揮核心作用。我們的客戶採用Cadence的軟體、硬體、設計方法和服務，來設計和驗證用於消費電子產品、網路和通訊設備以及電腦系統中的尖端半導體器件、印刷電路板和電子系統。公司總部位於美國加州聖荷塞市，在世界各地均設有銷售辦事處、設計中心和研究設施，以服務於全球電子產業。關於公司、產品及服務的更多資訊，敬請流覽公司網站 www.cadence.com
關於中芯國際
中芯國際積體電路製造有限公司（“中芯國際”，紐約證交所股票代碼：SMI，香港聯合交易所股票代碼：981），是世界領先的積體電路晶片代工企業之一， 也是中國內地規模最大、技術最先進的積體電路晶片代工企業。中芯國際向全球客戶提供0.35微米到45納米晶片代工與技術服務。中芯國際總部位於上海，在 上海建有一座300mm晶片廠和三座200mm晶片廠。在北京建有兩座300mm晶片廠,在天津建有一座200mm晶片廠，在深圳有一座200mm晶片廠 在興建中，在成都擁有一座封裝測試廠。中芯國際還在美國、歐洲、日本提供客戶服務和設立行銷辦事處，同時在香港設立了代表處。此外，中芯代成都成芯半導體 製造有限公司經營管理一座200mm晶片廠，也代武漢新芯積體電路製造有限公司經營管理一座300mm晶片廠。詳細資訊請參考中芯國際網站 http://www.smics.com
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楊麗莉
Cadence設計系統公司
電話：021 -61222358
Email：lilyyang@cadence.com
徐晶晶
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電話：021-64263989-216
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繆為夷
中芯國際公關處
電話：+8621 3861 0000
郵件：Angela_Miao@smics.com
劉慕華
中芯國際投資人關係處
電話：+86 21 3861 0000
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